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 * Our critical section barriers are prepared for the weakest RMO memory model.
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 * Our critical section barriers are prepared for the weakest RMO memory model.
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#define CS_ENTER_BARRIER()              \
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#define CS_ENTER_BARRIER()              \
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    asm volatile (              \
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    asm volatile (                  \
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        "membar #LoadLoad | #LoadStore\n"   \
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        "membar #LoadLoad | #LoadStore\n"   \
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        ::: "memory"                \
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    )
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#define CS_LEAVE_BARRIER()              \
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    asm volatile (              \
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        "membar #StoreStore\n"          \
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        "membar #StoreStore\n"          \
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        "membar #LoadStore\n"           \
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        "membar #LoadStore\n"           \
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        ::: "memory"                \
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        ::: "memory"                \
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